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CD4553引脚图及应用电路

电力电子 | 发布时间:2018-07-16 | 人气: | #评论# | 本文关键字:CD4553,引脚图,引脚定义,CC4553,电路图
摘要:CD4553/CC4553是3位十进制计数器,但只有1个输出端,要完成3位输出,采用扫描输出方式,通过它的选通脉冲信号,依次控制3位十进制的输出,从而实现扫描显示方式。 CD4553/CC4553 引脚功能: C

CD4553/CC4553是3位十进制计数器,但只有1个输出端,要完成3位输出,采用扫描输出方式,通过它的选通脉冲信号,依次控制3位十进制的输出,从而实现扫描显示方式。CD4553/CC4553引脚功能:CLOCK:计数脉冲输入端,下调沿有效。

CIA、CIB:内部振荡器的外界电容端子。   
MR:计数器清零(只清计数器部分),高电平有效。   
LE:锁定允许。当该端为低电平时,3组计数器的内容分别进入3组锁存器,当该端为高电平时,锁存器锁定,计数器的值不能进入。    
DIS:该端接地时,计数脉冲才能进行计数。   
DS1、DS2、DS3:位选通扫描信号的输出,这3端能循环地输出低电平,供显示器作为位通控制。   
Q0、Q1、Q2、Q3:BCD码输出端,它能分时轮流输出3组锁存器的BCD码。   
CD4553内部虽然有3组BCD码计数器(计数最大值为999),但BCD的输出端却只有一组Q0~Q3通过内部的多路转换开关能分时输出个、十、百位的BCD码,相应地,也输出3位位选通信号。例如:当Q0~Q3输出个位的BCD码时,DS1端输出低电平;当Q0~Q3输出十位的BCD码时,DS2端输出低电平;当Q0~Q3输出百位的BCD码时,DS3端输出低电平时,周而复始、循环不止。

真值表:

Inputs 输入

Outputs 输出
Master
Reset
ClockDisableLE
000No Change 没有变化
000Advance 进行
0x1xNo Change 没有变化
010Advance 进行
010No Change 没有变化
00xxNo Change 没有变化
0xxLatched 锁存
0xx1Latched 锁存
1xx0Q0=Q1=Q2=Q3=0

CD4553引脚图

              图1  CD4553引脚图

最大额定值(电压参考的VSS ):

Symbol 符号Parameter 参数Value 数值Unit单位
VDDDC Supply Voltage 直流供电电压 Range-0.5 to +18.0V
Vin, VoutInput or Output Voltage Range(DC or Transient)输入或输出电压范围(直流或瞬态)-0.5 to VDD +0.5V
IinInput Current (DC or Transient) per Pin 输入电流( 直流或瞬态)每个引脚±10mA
IoutOutput Current (DC or Transient) per Pin 输出电流( 直流或瞬态)每个引脚+20mA
PDPower Dissipation, per Package (Note 2.) 功耗500mW
TAAmbient Temperature Range 环境温度范围–55 to +125
TstgStorage Temperature Range储存温度范围–65 to +150

DC Electrical Characteristics 直流电气特性:

Characteristic 参数

符号

VDD Vdc– 55℃25℃125℃Unit单位

最小

最大

最小

典型

最大最小最大
Output Voltage 输出电压Vdc
Vin = VDD or 0“0” LevelVOL5.0
0.05
00.050.05
10
0.05
00.050.05
15
0.05
00.050.05
Vin = 0 or VDD“1” LevelVOH5.04.95
4.955.0
4.95
Vdc
109.95
9.9510
9.95
1514.95
14.9515
14.95
Input Voltage 输入电压Vdc
(VO=4.5 or 0.5Vdc)“0” LevelVIL5.0
1.5
2.251.5
1.5
(VO=9.0 or 1.0Vdc)10
3.0
4.503.0
3.0
(VO=13.5or1.5Vdc)15
4.0
6.754.0
4.0
(VO=0.5 or 4.5Vdc)“1” LevelVIH5.03.5
3.52.75
3.5
Vdc
(VO=1.0 or 9.0Vdc)107.0
7.05.50
7.0
(VO=1.5 or13.5Vdc)1511
118.25
11
Output Drive Current 输出驱动电流mAdc
(VOH = 4.6 Vdc)Source —Pin 3IOH5.0–0.25
–0.2–0.36
–0.14
(VOH = 9.5 Vdc)10–0.62
–0.5–0.9
–0.35
(VOH =13.5 Vdc)15–1.8
–1.5–3.5
–1.1
(VOH = 4.6 Vdc) (VOH = 9.5 Vdc) (VOH = 13.5Vdc)Source -Other Outputs5.0–0.64
–0.51–0.88
–0.36
mAdc
10–1.6
–1.3–2.25
–0.9
15–4.2
–3.4–8.8
–2.4
(VOL = 0.4 Vdc) (VOL = 0.5 Vdc)(VOL = 1.5 Vdc)Sink - Pin 3IOL5.00.5
0.40.88
0.28
mAdc
101.1
0.92.25
0.65
151.8
1.58.8
1.20
(VOL = 0.4 Vdc) (VOL = 0.5 Vdc) (VOL = 1.5 Vdc)Sink — Other Outputs5.03.0
2.54.0
1.6
mAdc
106.0
5.08.0
3.5
1518
1520
10
Input Current 输入电流Iin15±0.1±0.00001±0.1±1.0μAdc
Input Capacitance(Vin=0) 输入电容(输入电压= 0 )Cin5.07.5pF
Quiescent Current (Per Package) MR = VDD 静态电流IDD5.0
5.0
0.0105.0
150μAdc
10
10
0.02010
300
15
20
0.03020
600
Total Supply Current (Note 4., 5.) (Dynamic plus Quiescent, Per Package) (CL = 50 pF on all outputs, all buffers switching)IT5.0IT = (0.35 mA/kHz) f + IDDμAdc
10IT = (0.85 mA/kHz) f + IDD
15IT = (1.50 mA/kHz) f + IDD

交流开关特性:

Characteristic 参数FigureSymbol 符号VDD最小

典型

最大Unit单位
Output Rise and Fall Time
tTLH, tTHL = (1.5 ns/pF) CL + 25 ns
tTLH, tTHL = (0.75 ns/pF) CL + 12.5 ns tTLH, tTHL = (0.55 ns/pF) CL + 9.5 ns
2atTLH, tTHL5.0
100200ns
10
50100
15
4080
Clock to BCD Out 时钟的BCD输出2atPLH, tPHL5.0
9001800ns
10
5001000
15
200400
Clock to Overflow 时钟溢出2atPHL5.0
6001200ns
10
400800
15
200400
Reset to BCD Out 重的BCD输出2btPHL5.0
9001800ns
10
5001000
15
300600
Clock to Latch Enable Setup Time Master Reset to Latch Enable Setup Time2btsu5.0600300
ns
10400200
15200100
Removal Time Latch Enable to Clock2btrem5.0–80–200
ns
10–10–70
150–50
Clock Pulse Width 时钟脉冲宽度2atWH(cl)5.0550275
ns
10200100
1515075
Reset Pulse Width 复位脉冲宽度2btWH(R)5.01200600
ns
10600300
15450225
Reset Removal Time 重置移走时间trem5.0–80–180
ns
100–50
1520–30
Input Clock Frequency 输入时钟频率2afcl5.0
1.50.9MHz
10
5.02.5
15
7.03.5
Input Clock Rise Time 输入时钟上升时间2btTLH5.0No Limit 没有限制ns
10
15
Disable, MR, Latch Enable Rise and Fall TimestTLH, tTHL5.0

15ms
10

5.0
15

4.0
Scan Oscillator Frequency (C1 measured in mF)1fosc5.0
1.5/C1
Hz
10
4.2/C1
15
7.0/C1

CD4553 3位数计数器时序图

                                       图2      CD4553 3位数计数器时序图(参考图4)

CD4553 开关时间测试电路和波形

                                  图3   CD4553 开关时间测试电路和波形

CD4553方框图

                          图4 CD4553方框图

CD4553 6位数显示电路图

                                           CD4553 6位数显示电路图

责任编辑:CD4553
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